由于FPGA時(shí)鐘頻率高、內(nèi)部延時(shí)小、速度快、效率高、組成形式靈活等特點(diǎn)使其在高速數(shù)據(jù)采集方
面有著DSP 和單片機(jī)無(wú)法比擬的優(yōu)勢(shì)。 FPGA多數(shù)據(jù)采集卡的數(shù)據(jù)采集系統(tǒng)采用模塊化設(shè)計(jì)結(jié)構(gòu)，共由
4類模塊組成，各采集模塊可以互換或靈活增 減，各個(gè)模塊之間采用三通式連接器相連，傳感器信號(hào)、
422串行等信號(hào)輸入到對(duì)應(yīng)模塊中調(diào)理采集，由主控制 模塊控制統(tǒng)一編幀，并傳輸?shù)诫p備份存儲(chǔ)器中。
設(shè)計(jì)方案靈活、控制簡(jiǎn)單，具有很好的實(shí)用價(jià)值。
多通道模擬開(kāi)關(guān)的切換是數(shù)據(jù)采集卡的重要內(nèi)容，在本設(shè)計(jì)中，每塊數(shù)據(jù)采集卡都需要同時(shí)采集24
路不同頻率 的模擬信號(hào)，所以必須高精度、高準(zhǔn)確度控制采樣通道地址的切換與選擇，這對(duì)于硬件與
軟件的設(shè)計(jì)都提出很高 的要求。硬件部分采用的模擬開(kāi)關(guān)是ADG706，此為可以選通l6路信號(hào)的芯片，
由于采集通道為24路，所以每塊 采集卡上需要兩片ADG706芯片，開(kāi)關(guān)量達(dá)到16X2=32>24路，滿足
設(shè)計(jì)要求。
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